Standalone Nested Loop Acceleration on CGRAs for Signal Processing Applications - Archive ouverte HAL
Communication Dans Un Congrès Année : 2024

Standalone Nested Loop Acceleration on CGRAs for Signal Processing Applications

Domaines

Architectures Matérielles [cs.AR] Systèmes embarqués
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https://hal.science/hal-04505187

Soumis le : jeudi 14 mars 2024-16:52:04

Dernière modification le : mercredi 18 septembre 2024-15:28:04

Archivage à long terme le : samedi 15 juin 2024-19:12:59

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Dates et versions

hal-04505187 , version 1 (14-03-2024)

Licence

Paternité - Pas d'utilisation commerciale - Pas de modification

Identifiants

  • HAL Id : hal-04505187 , version 1

Citer

Chilankamol Sunny, Satyajit Das, Kevin J M Martin, Philippe Coussy. Standalone Nested Loop Acceleration on CGRAs for Signal Processing Applications. DASIP 2024: Workshop on Design and Architectures for Signal and Image Processing, Jan 2024, Munich, Germany. ⟨hal-04505187⟩

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