Hybrid architectures for check node processing of extended min-sum (EMS) decoding of non-binary LDPC codes - Archive ouverte HAL
Brevet Année : 2017

Hybrid architectures for check node processing of extended min-sum (EMS) decoding of non-binary LDPC codes

Domaines

Traitement du signal et de l'image [eess.SP]

Cédric Marchand  : Connectez-vous pour contacter le contributeur

https://hal.science/hal-02153226

Soumis le : mercredi 12 juin 2019-09:59:20

Dernière modification le : mercredi 30 octobre 2024-03:11:15

Fichier non déposé

Dates et versions

hal-02153226 , version 1 (12-06-2019)

Identifiants

  • HAL Id : hal-02153226 , version 1

Citer

Cédric Marchand, Emmanuel Boutillon. Hybrid architectures for check node processing of extended min-sum (EMS) decoding of non-binary LDPC codes. France, Patent n° : EP3419179A1. 2017. ⟨hal-02153226⟩

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