Communication Dans Un Congrès
Année : 2000
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https://hal.science/hal-01573065
Soumis le : mardi 8 août 2017-14:20:53
Dernière modification le : mardi 11 avril 2023-15:16:28
Dates et versions
Identifiants
- HAL Id : hal-01573065 , version 1
Citer
Laurent Vuillemin, Pirouz Bazargan Sabet. Timed simulation of VLSI circuits using a FPGA net. Applied Informatics (IASTED AI 2000), May 2000, Innsbruck, Austria. ⟨hal-01573065⟩
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